{"id":2799,"date":"2025-07-25T10:15:20","date_gmt":"2025-07-25T09:15:20","guid":{"rendered":"https:\/\/workboot.fr\/ciela\/?page_id=2799"},"modified":"2025-07-25T10:18:18","modified_gmt":"2025-07-25T09:18:18","slug":"arm","status":"publish","type":"page","link":"https:\/\/workboot.fr\/ciela\/arm\/","title":{"rendered":"ARM"},"content":{"rendered":"\n

Introduction \u00e0 ARM<\/strong><\/h2>\n\n\n\n

ARM est une architecture de processeurs bas\u00e9e sur le concept RISC<\/strong> (Reduced Instruction Set Computer), ce qui signifie qu’elle utilise un ensemble d’instructions simplifi\u00e9es pour une ex\u00e9cution plus rapide et une consommation d’\u00e9nergie r\u00e9duite.<\/p>\n\n\n\n

Caract\u00e9ristiques principales :<\/strong><\/h3>\n\n\n\n
    \n
  • Faible consommation d’\u00e9nergie<\/strong>\u00a0\u2192 Id\u00e9al pour les appareils mobiles (smartphones, tablettes, IoT).<\/li>\n\n\n\n
  • Architecture modulaire<\/strong>\u00a0\u2192 Plusieurs versions (Cortex-A, Cortex-M, Cortex-R) adapt\u00e9es \u00e0 diff\u00e9rents besoins.<\/li>\n\n\n\n
  • Licence flexible<\/strong>\u00a0\u2192 ARM ne fabrique pas ses propres puces, mais vend des licences \u00e0 des fabricants (Qualcomm, Apple, Samsung, etc.).<\/li>\n<\/ul>\n\n\n\n

    Familles de processeurs ARM<\/strong><\/h2>\n\n\n\n
    Famille<\/th>Utilisation<\/th>Exemples<\/th><\/tr><\/thead>
    Cortex-A<\/strong><\/td>Applications haute performance (OS, smartphones)<\/td>Snapdragon (Qualcomm), Apple M1\/M2<\/td><\/tr>
    Cortex-M<\/strong><\/td>Microcontr\u00f4leurs embarqu\u00e9s (IoT, capteurs)<\/td>STM32 (STMicro), nRF52 (Nordic)<\/td><\/tr>
    Cortex-R<\/strong><\/td>Temps r\u00e9el (automobile, disques durs)<\/td>Contr\u00f4leurs de stockage, ABS voiture<\/td><\/tr><\/tbody><\/table><\/figure>\n\n\n\n

    Mode d’ex\u00e9cution et registres<\/strong><\/h2>\n\n\n\n

    ARM fonctionne principalement en mode 32 bits (ARMv7) ou 64 bits (ARMv8-A)<\/strong>.<\/p>\n\n\n\n

    Registres principaux (ARM 32 bits) :<\/strong><\/h3>\n\n\n\n
      \n
    • R0 \u00e0 R12<\/strong>\u00a0\u2192 Registres g\u00e9n\u00e9raux.<\/li>\n\n\n\n
    • R13 (SP)<\/strong>\u00a0\u2192 Stack Pointer (pointeur de pile).<\/li>\n\n\n\n
    • R14 (LR)<\/strong>\u00a0\u2192 Link Register (adresse de retour des fonctions).<\/li>\n\n\n\n
    • R15 (PC)<\/strong>\u00a0\u2192 Program Counter (pointeur d’instruction).<\/li>\n\n\n\n
    • CPSR<\/strong>\u00a0\u2192 Registre d’\u00e9tat (flags Z, N, C, V).<\/li>\n<\/ul>\n\n\n\n

      En 64 bits (ARMv8), les registres sont \u00e9tendus \u00e0 X0-X30<\/strong>.<\/p>\n\n\n\n

       Jeu d’instructions ARM (ASM)<\/strong><\/h2>\n\n\n\n

      Syntaxe de base :<\/strong><\/h3>\n\n\n\n

      code assembleur<\/p>\n\n\n\n

      MOV R0, #42      ; R0 = 42\nADD R1, R2, R3   ; R1 = R2 + R3\nCMP R0, R1       ; Compare R0 et R1 (met \u00e0 jour les flags)\nBGT label        ; Saute si \"Greater Than\"<\/code><\/pre>\n\n\n\n
      Quelques instructions courantes :<\/strong><\/h3>\n\n\n\n
      Instruction<\/th>Description<\/th><\/tr><\/thead>
      MOV Rd, Op<\/code><\/td>D\u00e9place une valeur dans un registre<\/td><\/tr>
      ADD\/SUB Rd, Rn, Op<\/code><\/td>Addition\/Soustraction<\/td><\/tr>
      LDR Rd, [Rn]<\/code><\/td>Charge depuis la m\u00e9moire<\/td><\/tr>
      STR Rd, [Rn]<\/code><\/td>Stocke en m\u00e9moire<\/td><\/tr>
      B label<\/code><\/td>Saut inconditionnel<\/td><\/tr>
      BL func<\/code><\/td>Appel de fonction (stocke l’adresse de retour dans LR)<\/td><\/tr><\/tbody><\/table><\/figure>\n\n\n\n
      Pipeline et performances<\/strong><\/h2>\n\n\n\n
      ARM utilise un pipeline<\/strong> pour ex\u00e9cuter plusieurs instructions en parall\u00e8le (3 \u00e0 15 \u00e9tapes selon les mod\u00e8les).<\/p>\n\n\n\n
        \n
      • Avantage<\/strong>\u00a0: Augmente le d\u00e9bit d’ex\u00e9cution.<\/li>\n\n\n\n
      • Inconv\u00e9nient<\/strong>\u00a0: Risque de \u00ab\u00a0hazards\u00a0\u00bb (d\u00e9pendances entre instructions).<\/li>\n<\/ul>\n\n\n\n
        ARM vs x86<\/strong><\/h2>\n\n\n\n
        Crit\u00e8re<\/strong><\/th>ARM<\/strong><\/th>x86 (Intel\/AMD)<\/strong><\/th><\/tr><\/thead>
        Philosophie<\/strong><\/td>RISC (instructions simples)<\/td>CISC (instructions complexes)<\/td><\/tr>
        Consommation<\/strong><\/td>Tr\u00e8s faible<\/td>\u00c9lev\u00e9e (sauf mod\u00e8les r\u00e9cents)<\/td><\/tr>
        Performances<\/strong><\/td>Optimis\u00e9 pour mobile\/embarqu\u00e9<\/td>Optimis\u00e9 pour PC\/serveurs<\/td><\/tr>
        Licence<\/strong><\/td>Vendue \u00e0 d’autres soci\u00e9t\u00e9s<\/td>Fabriqu\u00e9 par Intel\/AMD<\/td><\/tr><\/tbody><\/table><\/figure>\n\n\n\n
        Applications d’ARM<\/strong><\/h2>\n\n\n\n
          \n
        • Smartphones<\/strong>\u00a0(95% du march\u00e9 : Apple A16, Snapdragon 8 Gen 2).<\/li>\n\n\n\n
        • Objets connect\u00e9s (IoT)<\/strong>\u00a0: Capteurs, montres, domotique.<\/li>\n\n\n\n
        • Serveurs<\/strong>\u00a0: Graviton (Amazon), Ampere (ARM pour data centers).<\/li>\n\n\n\n
        • Ordinateurs<\/strong>\u00a0: Apple Silicon (M1\/M2), Raspberry Pi.<\/li>\n<\/ul>\n\n\n\n
          <\/p>\n","protected":false},"excerpt":{"rendered":"
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